CIS製品の高機能化に伴い各種アナログIPにはより高精度・低電力・低コストなどの差異化が求められており、大きくは下記のいずれかをお願いします。
1, GPIO/LVDSやSPMI/I2C/I3C等の通信規格の物理層IPアナログ回路設計
2, PLL/DLL等の位相/遅延フィードバック制御IPアナログ回路設計
3, LDO/チャージポンプ/バイアス回路などの電源IPアナログ回路設計
■想定ポジション
それぞれの開発チームは~3名程度の正社員、および、作業工数に応じた協力会社で構成され、そのリーダーの役割となります。
比較的短期間に製品適用を求められるIP開発・導入となるため、多数関係者へのコミュニケーション能力も発揮できるポジションとなります。
■描けるキャリアパス
例えば様々な分野に応用されている機械学習機能の進化にCiM(Computing in Memory)といったメモリIPベースのIPが注目されています。
将来の製品に欠かせないキラーIPの第一人者として活躍することもできます。
また、スタンダードセルやメモリといったIP開発者、製品化で必要なESD設計者とともに知の共有ができIPライブラリ全体のリーダーとして活躍する事もできます。
さらに優秀な人材には希望に即したJOBローテーションで幅広く活躍してもらう準備があります。
■職場雰囲気
年代層は幅広く、それぞれが多様なバックグラウンドを持つチームです。また、近年は新卒・インターン採用を積極的に行って若返りを図っています。
新メンバーには既存メンバーと会話する機会を作るプロジェクトに参加してもらって交流促進を図っています。
また、オンラインとFace to Faceを状況により使い分けて気軽に話す機会を作り、業務相談もしやすくなるように努めています。
●必須
GPIO/LVDSやSPMI/I2C/I3C等の通信規格の物理層IP開発経験者 or 位相/遅延フィードバック制御IP開発経験者 or 電源IP開発経験者
●尚可
特許取得経験あり 海外ベンダーとの協業経験あり
【求める語学力】
●必須
TOEIC 650点以上
●尚可
TOEIC 800点以上
海外ベンダーとの協業経験があると尚可
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